芯片解密数码产品中ESD问题解决与防护
芯片解密产品的结构设计
如果将释放的静电看成是洪水的话，那么主要的解决方法与治水类似，就是“堵”和“疏”。如果我们设计的产品有一个理想的壳体是密不透风的，静电也就无从而入，当然不会有静电问题了。但实际的壳体在合盖处常有缝隙，而且许多还有金属的装饰片，所以一定要加以注意。
芯片解密用“堵”的方法。尽量增加壳体的厚离，即增加外壳到电路板之间的距离，或者通过一些等效方法增加壳体气隙的距离，这样可以避免或者大大减少ESD的能量强度。
通过结构的改进，可以增大外壳到内部电路之间气隙的距离从而使ESD的能量大大减弱。根据经验，8kV的ESD在经过4mm的距离后能量一般衰减为零。
芯片解密用“疏”的方法，可以用EMI油漆喷涂在壳体的内侧。EMI油漆是导电的，可以看成是一个金属的屏蔽层，这样可以将静电导在壳体上;再将壳体与 PCB(Printed Circuit Board)的地连接，将静电从地导走。这样处理的方法除了可以防止静电，还能有效抑制EMI的干扰。如果有足够的空间，还可以用一个金属屏蔽罩将其中的电路保护起来，金属屏蔽罩再连接PCB的GND。
总之，ESD设计壳体上需要注意很多地方，首先是尽量不让ESD进入壳体内部，最大限度地减弱其进入壳体的能量。对于进入壳体内部的ESD尽量将其从GND导走，不要让其危害电路的其它部分。壳体上的金属装饰物使用时一定要小心，因为很可能带来意想不到的结果，需要特别注意。
芯片解密产品的PCB设计
现在产品的 PCB(Printed Circuit Board)都是高密度板，通常为4层板。随着密度的增加，趋势是使用6层板，其设计一直都需要考虑性能与面积的平衡。一方面，越大的空间可以有更多的空间摆放元器件，同时，走线的线宽和线距越宽，对于EMI、音频、ESD等各方面性能都有好处。另一方面，数码产品设计的小巧又是趋势与需要。所以，设计时需要找到平衡点。就ESD问题而言，设计上需要注意的地方很多，尤其是关于GND布线的设计以及线距，很有讲究。有些产品中ESD存在很大的问题，一直找不到原因，通过反复研究与实验，发现是PCB设计中的出现的问题。为此，这里总结了PCB设计中应该注意的要点：
(1)PCB板边(包括通孔Via边界)与其它布线之间的距离应大于0.3mm;
(2)PCB的板边最好全部用GND走线包围;
(3)GND与其它布线之间的距离保持在0.2mm～0.3mm;
(4)Vbat与其它布线之间的距离保持在0.2mm～0.3mm;
(5)重要的线如Reset、Clock等与其它布线之间的距离应大于0.3mm;
(6)大功率的线与其它布线之间的距离保持在0.2mm～0.3mm;
(7)不同层的GND之间应有尽可能多的通孔(VIa)相连;
(8)在最后的铺地时应尽量避免尖角，有尖角应尽量使其平滑。
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